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[转]VErilog和VHDL学哪个好

比如你用Verilog写代码,别人用VHDL写的代码你能看懂就行了。2.关于器件当初在学校的时候不知道为什么对Xilinx鬼迷心窍,对Altera有点反感,有关Altera的资料一般都不看,实际工作后,才知道一般公司Xilinx、Altera、Lattice的产品都会用,主要...

VHDL 源于军方的ADA编程,而verilog则源于我们熟悉的C语言。 所以,学verilog入门较快,快的话几天就可以掌握全部语法。当然只是理解和懂得,灵活的运用还要依靠大量的实践。 而相对来说VHDL入门则比较难。 关于两者的好坏,谁也所不清。 有人说...

VHDL 源于军方的ADA编程,而verilog则源于我们熟悉的C语言。 所以,学verilog入门较快,快的话几天就可以掌握全部语法。当然只是理解和懂得,灵活的运用还要依靠大量的实践。 而相对来说VHDL入门则比较难。 关于两者的好坏,谁也所不清。 有人说...

我个人用的是VHDL语言,相比Verilog来说VHDL严谨一些,而Verilog的语言模式很像C语言,比较灵活。 从设计的角度来看,Verilog经常用来设计从小到规模的集成电路的设计,而VHDL偏向于中规模到超大规模的集成电路的设计。 目前国内的使用程度来看...

一般来说现在工作上用verilog和用vhdl都没有硬性要求,而且现在的开发软件都可以兼容两种语言共同开发。建议先学习verilog,因为比较容易上手,而且很灵活,基本上常用的电路都能描述出来,等到能灵活运用verilog之后,有时间的话也可以学一下vh...

我大学学的VHDL,现在用的verilog,感觉verilog更像一门语言,VHDL更像电路,但是究其根本,还是电路、数据流的设计;形象点来说

如果说学习程度低,知识不是太高,就学一个不涉及到以前那些语数外知识的纯技术,不然学起来也恼火。 现在的话,餐饮业发展很不错,学厨师挺可以的。 厨师是现在大家都知道的高薪职业,比好多行业都好。人家说,有人的地方就有酒店,有酒店的地...

硬件描述语言HDL(Hardware Describe Language) HDL概述 随着EDA技术的发展,使用硬件语言设计PLD/FPGA成为一种趋势。目前最主要的硬件描述语言是VHDL和Verilog HDL。 VHDL发展的较早,语法严格,而Verilog HDL是在C语言的基础上发展起来的一种...

一般认为verilog更灵活效率高(以较少的代码实现相同功能)拥有一些vhdl没有的系统函数比如$time、$random等vhdl语法严格某些错误在语法分析阶段就可以被发现抽象层次较verilog略高具有一些verilog没有的功能比如可以定义模块端口为多维数组类型...

FPGA是你要用到的工具,而Verilog是你在使用FPGA时所运用语言。也就是说,在你设计一个项目之前,你要先通过verilog语言吧他描述出来(也就是写代码),然后再通过软件(如ISE)将代码移植到FPGA开发板上进行验证(用眼睛看)。你所要研究是应该...

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